職位描述
Verilog HDL電子/半導體/集成電路
主要方向是高速數(shù)據(jù)處理及簡單的算法實現(xiàn)
1、具有高速數(shù)據(jù)處理及算法實現(xiàn)經(jīng)驗，熟悉高速傳輸接口（如Serdes接口、高速以太接口、DDR等）及低速接口（SPI/UART）時序及設計。
2、熟悉FPGA架構，至少掌握一款主流FPGA器件系統(tǒng)架構，設計思路，開發(fā)方式及調(diào)試方法，具備上板調(diào)試能力，能夠分析并解決調(diào)試過程中遇到的問題；
3、熟悉FPGA時序約束、時序分析、時序優(yōu)化方法。
1、具有高速數(shù)據(jù)處理及算法實現(xiàn)經(jīng)驗，熟悉高速傳輸接口（如Serdes接口、高速以太接口、DDR等）及低速接口（SPI/UART）時序及設計。
2、熟悉FPGA架構，至少掌握一款主流FPGA器件系統(tǒng)架構，設計思路，開發(fā)方式及調(diào)試方法，具備上板調(diào)試能力，能夠分析并解決調(diào)試過程中遇到的問題；
3、熟悉FPGA時序約束、時序分析、時序優(yōu)化方法。
工作地點
成都雙流區(qū)電子科技大學科技園B2-2
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