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更新于 9月30日
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舉報(bào)

FPGA工程師（ATE）

7000-10000元
  • 成都成華區(qū)
  • 1-3年
  • 本科
  • 全職
  • 招1人

職位描述

Verilog HDL電子/半導(dǎo)體/集成電路工業(yè)自動(dòng)化
工作內(nèi)容：
1. 協(xié)助項(xiàng)目負(fù)責(zé)人，評(píng)估客戶所提出的技術(shù)相關(guān)需求，協(xié)助完成客戶技術(shù)協(xié)議到研發(fā)設(shè)計(jì)方案的轉(zhuǎn)化；
2. 根據(jù)具體實(shí)施方案，負(fù)責(zé)控制板程序設(shè)計(jì)，包括跟上位機(jī)的通信協(xié)議，實(shí)現(xiàn)外設(shè)控制、時(shí)序控制、脈沖控制、自動(dòng)天線校準(zhǔn)、掃描等功能；
3. 參與產(chǎn)品相關(guān)硬件設(shè)計(jì)的評(píng)審；
4. 負(fù)責(zé)天線測(cè)試系統(tǒng)配套控制系統(tǒng)程序開(kāi)發(fā)，快速測(cè)試提升效率等;
5. 對(duì)研發(fā)和生產(chǎn)過(guò)程中反饋的軟件相關(guān)問(wèn)題進(jìn)行整理和總結(jié)；
6. 完成領(lǐng)導(dǎo)交辦的其他工作。
任職要求：
1. 本科及以上學(xué)歷，電子、通信、自動(dòng)化、軟件等相關(guān)專業(yè)；
2. 熟悉FPGA、DSP等程序的設(shè)計(jì)、仿真和調(diào)試；
3. 熟練VERILOG或VHDL語(yǔ)言，代碼風(fēng)格規(guī)范，熟練使用相關(guān)開(kāi)發(fā)仿真軟件（同時(shí)熟練使用VIVADO和ISE軟件者優(yōu)先）；
4. 熟練使用信號(hào)源、示波器、頻譜儀等測(cè)試設(shè)備；
5.具有較強(qiáng)的邏輯思維能力及獨(dú)立解決問(wèn)題能力者優(yōu)先;
6. 有控制軟件設(shè)計(jì)開(kāi)發(fā)經(jīng)驗(yàn)的應(yīng)屆生優(yōu)先。
公司簡(jiǎn)介：
創(chuàng)立于2019月1月，專注于微波毫米波頻段的天線、組件、芯片等領(lǐng)域的設(shè)計(jì)、開(kāi)發(fā)、生產(chǎn)、銷售、服務(wù)于一體的高新技術(shù)企業(yè)。擁有一支長(zhǎng)期從事微波毫米波產(chǎn)品研發(fā)、生產(chǎn)、銷售的高素質(zhì)專業(yè)團(tuán)隊(duì)，核心團(tuán)隊(duì)擁有毫米波領(lǐng)域超過(guò)十年的從業(yè)經(jīng)驗(yàn)。公司已掌握多種關(guān)鍵技術(shù)，主要有毫米波頻段SIP集成技術(shù)、多通道RFIC/MMIC 相關(guān)設(shè)計(jì)技術(shù)、相控陣天線集成技術(shù)、大功率瓦片式散熱技術(shù)等。
福利待遇：
1.轉(zhuǎn)正后工資可觀，每月工資準(zhǔn)時(shí)發(fā)！
2.績(jī)效獎(jiǎng)金，年終獎(jiǎng)金！
3.七險(xiǎn)一金（社保+商業(yè)保險(xiǎn)+補(bǔ)充醫(yī)療險(xiǎn)+公積金）；
4.帶薪假期：法定假、婚假、產(chǎn)假、陪產(chǎn)假、年假、全薪病假等；
5.免費(fèi)工作餐、加班餐；
6.加班交通費(fèi)；
7.其它福利：
1）健康體檢、婚育禮金、節(jié)日福利；
2）生日會(huì)、部門聚餐、公費(fèi)旅游；
3）年會(huì)、體育活動(dòng)。

工作地址：成都市成華區(qū)航天路99號(hào)金地威新·成華創(chuàng)新基地5C幢

工作地點(diǎn)

成都成華區(qū)金地威新成華創(chuàng)新基地5C幢

職位發(fā)布者

付佳玉/人事經(jīng)理

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公司Logo成都華芯天微科技有限公司
成都華芯天微科技有限公司是一家專注于射頻、微波（毫米波）頻段的天線、組件、芯片等領(lǐng)域的設(shè)計(jì)、開(kāi)發(fā)、生產(chǎn)、銷售、服務(wù)于一體的高新技術(shù)企業(yè)。公司擁有一支從事射頻、微波（毫米波）產(chǎn)品研發(fā)、生產(chǎn)、銷售的高素質(zhì)專業(yè)團(tuán)隊(duì)，其中包括多名長(zhǎng)期從事毫米波天線微系統(tǒng)、芯片等產(chǎn)品開(kāi)發(fā)的教授、高級(jí)工程師。
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